從門級理解D觸發(fā)器的建立時間和保持時間
正常狀態(tài)：
- 在時鐘低電平期間，主鎖存器Q端跟隨D端數(shù)據(jù)；
- 時鐘高電平時，主鎖存器Q端保持之前跟隨的數(shù)據(jù)，從鎖存器Q端跟隨從鎖存器的D端（也就是主鎖存器Q端）；
- 時鐘再次來到低電平時，主鎖存器Q端跟隨D端，等待下一個數(shù)據(jù)的到來，而此時從鎖存器Q端保持輸出不變，從而整體達到上升沿數(shù)據(jù)變化的效果。
建立時間不足：
- 時鐘低電平期間，主鎖存器D端數(shù)據(jù)來得較晚，主鎖存器Q端未成功跟隨到D端的數(shù)據(jù)；
- 然后時鐘高電平就已經(jīng)來了，主鎖存器Q端輸出無法保持，出現(xiàn)不穩(wěn)定的狀態(tài)，自然從鎖存器的輸出也變?yōu)椴环€(wěn)定的狀態(tài)，導致整個D觸發(fā)器出現(xiàn)亞穩(wěn)態(tài)
保持時間不足：
- 時鐘低電平期間，主鎖存器Q端已成功跟隨到D端的數(shù)據(jù)；
- 然后不等時鐘高電平到來，主鎖存器D端的數(shù)據(jù)就又發(fā)生了變化，主鎖存器Q端開始跟隨D端上新的數(shù)據(jù)；
- 此時時鐘高電平才姍姍來遲，主鎖存器Q端輸出出現(xiàn)不穩(wěn)定的狀態(tài)，同樣從鎖存器的輸出也變?yōu)椴环€(wěn)定的狀態(tài)，導致整個D觸發(fā)器出現(xiàn)亞穩(wěn)態(tài)
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